Увеличение объема памяти ЗУ

С использованием описанных структур можно строить память с любым заданным объемом информации. Однако на практике приходится иметь дело со стандартным рядом ИС, организация и объем памяти, которых заданы. Как правило, эти показатели не совпадают с требованиями конкретной аппаратуры, и встает задача построения на ИС ЗУ заданной организации ЗУ с требуемой организацией

Для этой цели используются два технических решения: наращивание разрядности хранимых слов; наращивание числа хранимых слов. Используя одновременно оба этих метода, можно увеличить как разрядность, так и количество хранимой информации.

Увеличить разрядность хранимых в памяти слов можно параллельным включением нескольких одинаковых ИС. На рис. 8.3. показано построение ЗУ с организацией бит на основе ИС с организацией . Для этого один и тот же адрес необходимо подать одновременно на адресные входы 4-х ИС. С выхода D0 каждой ИС по указанному адресу будет считан 1 бит информации. Следовательно, подключив выходы ИС к соответствующим разрядам 4-х разрядной шины, с последней можно считать 4-х разрядное слово. Таким образом, наращивание разрядности хранимых информационных слов не требует применения дополнительных технических средств и может быть выполнено простым соединением имеющихся ИС.

Сложнее обстоит дело при необходимости увеличения количества хранимых в памяти слов. Ранее отмечалось, что количество хранимых в памяти кодовых слов однозначно связано с разрядностью используемого адресного слова. Поэтому его увеличение требует увеличения разрядности шины адреса. Однако, так как разрядность адресного слова для конкретного типа ИС задана, решить эту задачу без привлечения дополнительных аппаратных средств не представляется возможным.

Практически задача увеличения количества хранимых слов решается с использованием дополнительного дешифратора, предназначенного для формирования сигнала разрешения работы нескольким параллельно включенным по выходам ИС. Данное решение иллюстрируется рис. 8.4. на котором показано выполнение памяти на основе ИС с собственной организацией . Для обращения к объему памяти в 4К необходимо 12-разрядное адресное слово. Интегральная схема заданного типа управляется 10-разрядным адресным словом. Два старших разряда адреса А11 и А10 подаются на адресные входы дополнительного дешифратора, выходы которого подсоединены к входам соответствующих ИС. Поэтому при подаче адреса дешифратор старших разрядов из четырех ИС выберет только ту, в которой хранится нужная информация. Выходы остальных ИС будут отключены от выходной шины данных, с которой будет считана только соответствующая поданному адресу информация.

Дата добавления: 2014-03-11; просмотров: 549; Нарушение авторских прав

Мы поможем в написании ваших работ!